PIC18F26J50-I/ML【PDF 8/32 页】IC PIC MCU FLASH 64K 2V 28-QFN

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PIC18F2XJXX/4XJXX FAMILY

DS39687E-page 16

2009 Microchip Technology Inc.

4.0

READING THE DEVICE

4.1

Read Code Memory

Code memory is accessed one byte at a time via the

4-bit command, ‘1001’ (table read, post-increment).

The contents of memory pointed to by the Table Pointer

(TBLPTRU:TBLPTRH:TBLPTRL) are serially output on

PGD.

The 4-bit command is shifted in LSb first. The read is

executed during the next 8 clocks, then shifted out on

PGD during the last 8 clocks, LSb to MSb. A delay of

P6 must be introduced after the falling edge of the 8th

PGC of the operand to allow PGD to transition from an

input to an output. During this time, PGC must be held

low (see Figure 4-1). This operation also increments

the Table Pointer by one, pointing to the next byte in

code memory for the next read.

This technique will work to read any memory in the

000000h to 3FFFFFh address space, so it also applies

to reading the Configuration registers.

TABLE 4-1:

READ CODE MEMORY SEQUENCE

FIGURE 4-1:

TABLE READ, POST-INCREMENT INSTRUCTION TIMING (1001)

4-Bit

Command

Data Payload

Core Instruction

Step 1: Set Table Pointer.

0000

0E <Addr[21:16]>

6E F8

0E <Addr[15:8]>

6E F7

0E <Addr[7:0]>

6E F6

MOVLW Addr[21:16]

MOVWF TBLPTRU

MOVLW <Addr[15:8]>

MOVWF TBLPTRH

MOVLW <Addr[7:0]>

MOVWF TBLPTRL

Step 2: Read memory and then shift out on PGD, LSb to MSb.

1001

00 00

TBLRD *+

234

PGC

PGD

PGD = Input

Shift Data Out

PGD = Output

P5A

10 11

15 16

Fetch Next 4-Bit Command

PGD = Input

LSb

MSb

P14

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